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隨機 記憶體 驅動 電路的問題，我們搜遍了碩博士論文和台灣出版的書籍，推薦趙英傑寫的 超圖解 Arduino 互動設計入門(第四版) 和何賓的 Xilinx Vivado數字設計權威指南：從數字邏輯、Verilog HDL、嵌入式系統到圖像處理都 可以從中找到所需的評價。
這兩本書分別來自旗標 和電子工業所出版 。
國立陽明交通大學 電控工程研究所 洪浩喬所指導 陳柏璋的 應用於記憶內運算電路之8T 8-kb靜態隨機存取記憶體電流特徵測試電路實現 （2021），提出隨機 記憶體 驅動 電路關鍵因素是什麼，來自於人工智慧、馮紐曼瓶頸、記憶體內運算、記憶體單元電流、8T SRAM。
而第二篇論文國立陽明交通大學 光電工程研究所 劉柏村所指導 李侑軒的 低功耗非晶態氧化銦鎢鋅之銅導電橋式記憶體與薄膜電晶體整合研究 （2021），提出因為有 內嵌式記憶像素、電橋式隨機存取記憶體、薄膜電晶體、1T1R、氧化銦鎢鋅、低功率消耗的重點而找出了 隨機 記憶體 驅動 電路的解答。
超圖解 Arduino 互動設計入門(第四版)
為了解決隨機 記憶體 驅動 電路 的問題，作者趙英傑 這樣論述：
華文世界銷售第一的 Arduino 創客經典教材！ 本書的目標是讓高中以上, 沒有電子電路基礎, 對微電腦、電子 DIY 及互動裝置有興趣的人士, 也能輕鬆閱讀, 進而順利使用 Arduino 控制板自造完成各種互動應用, 加入創客的行列。因此, 實驗用到的電子和程式觀念, 皆以手繪圖解的方式說明, 看圖就能懂。主要特色如下： ■ 【超清楚手繪接線圖, 人人都能動手當創客】：製作電子實驗一定要動手接電路, 本書利用手繪方式提供超清楚的實體接線圖, 只要對照圖中的接線與電子零件標示, 就可以在麵包板上正確接好線路, 進行實驗。除了手繪接線圖外, 本書也會提供對照的電路圖,
讓讀者不只入門容易, 也為將來邁向專業等級做好準備。 ■ 【程式語言從零開始, 人人都能設計程式】：使用 Arduino 製作互動設計除了組裝電路外, 最重要的就是要能夠撰寫程式控制互動邏輯。本書特別以手繪的程式觀念圖以及清楚易懂的流程圖, 從零開始說明程式設計的基礎觀念, 即使沒有程式設計經驗, 也可依照書中說明動手撰寫互動程式。 ■ 【隨手自造享受無窮樂趣】：除了花錢購買電子零件以外, 本書還會教您利用身邊現有的材料自造出令人驚艷的有趣設計, 像是使用廢棄的塑膠硬殼製作簡易機器手臂、將廢棄的軟碟片改造成電子鼓、將玩具模型車變成可自動躲避障礙物的智慧型自走車等。 ■
【Arduino × Android 互動串連】：互動裝置能夠遙控更是酷, 本書也會介紹如何結合 Arduino 與 Android 雙 A 裝置, 透過藍牙無線傳輸設計個人專屬的藍牙遙控機器人, 還可以自己開發 App, 延伸自造樂趣。 ■ 【邁入科技潮流物聯網應用世界】：使用網路模組讓 Arduino 互動裝置上網, 即可透過客製化的網頁遠端遙控家電, 邁入物聯網的世界。本書更進一步介紹可無線連網的 D1 mini 控制板, 拓展物聯網的範圍, 任何人都可以自由自造智慧生活所需要的各種無線裝置。 ■ 【精心設計 DIY 趣味範例】：包括手機藍牙遙控機器人、連網智慧家電控制
、光感應音樂盒、聲控開關、自動調光小夜燈、LED 矩陣動畫與文字跑馬燈、電子尺、電子燭光特效、避障自走車、數位溫濕度計、體感控制機器手臂、自動尋軌車、RFID 門禁控制、模擬悠遊卡儲存值、入侵偵測 LINE 警報通知器、遠端網頁調光器等。 第四版並提升實驗零件取得的容易度, 從原本改造身邊的電子產品和玩具著手, 搭配組裝電子零件的 DIY 風格, 改成盡量採用方便購買的現成模組, 以求自學實作及老師授課的便利, 不過在使用這些現成的模組時, 同時也會說明模組內部的電路及其運作原理, 避免許多初學者一旦沒有模組可用, 就不知道該如何完成相同功能的困境。 此外第四版也在程式設計和演
算法上更加全面地介紹 Arduino 程式語言, 包含物件導向程式設計和自製程式庫等進階主題。部分內容雖然因為篇幅有限, 從紙本書中移除, 但仍採電子書形式提供給讀者參考, 方便讀者查閱進修。書末更提供中文電腦書通常沒有的索引，更是作者花費長時間精心整理完成, 期望能讓本書在學習之餘, 更能成為各位手邊最便利好查的工具書。 本書特色 ■ 華文世界銷售第一的 Arduino 創客經典教材！ ■ 超圖解、人人都能看得懂 ■ 沒學過電子電路也能做出來 ■ 沒寫過程式也能從零開始 ■ 隨手自造享受無窮樂趣 ■ Arduino × Android 互動串連 ■ 邁
入科技潮流物聯網應用世界
應用於記憶內運算電路之8T 8-kb靜態隨機存取記憶體電流特徵測試電路實現
為了解決隨機 記憶體 驅動 電路 的問題，作者陳柏璋 這樣論述：
隨著近幾年來人工智慧的興起，各領域的專家學者們致力於研究人工智慧、機器學習與深度學習來驅動各種創新技術的實現。由於人工智慧系統需要執行大量的資料運算，導致對電腦速度的要求越來越高，若使用將中央處理器(CPU)與記憶體分開的傳統馮紐曼架構電腦，在CPU與記憶體之間資料傳輸的過程需消耗相當多的時間與功率，導致系統面臨資料處理速度緩慢與大量功耗的問題，這個現象稱作逢紐曼瓶頸。為了解決這個問題，記憶體內運算這個概念被提出，將需要處理的資料運算在記憶體內完成，減少資料需要在CPU與記憶體之間傳輸的次數，因而大幅減少功耗與資料傳輸的時間。近幾年來各式各樣的記憶體內運算電路被提出，其中有許多設計使用靜態隨
機存取記憶體(SRAM)陣列中的記憶體單元電流來完成記憶體內運算，然而由於受到製程漂移的影響，記憶體陣列中的每個記憶體單元電流並不相同造成運算結果產生錯誤。為了解決這個問題，本論文利用90nm CMOS實現了一個測試電路以測量一容量為8kb之8T SRAM陣列中每個記憶體單元之I/V電氣特性，據以了解製程飄移對使用SRAM陣列執行記憶體內運算的影響，並藉由量測結果決定出記憶體內運算電路合理的設計規格，避免過度設計浪費成本與功耗。
Xilinx Vivado數字設計權威指南：從數字邏輯、Verilog HDL、嵌入式系統到圖像處理
為了解決隨機 記憶體 驅動 電路 的問題，作者何賓 這樣論述：
本書以Xilinx公司的Vivado 2018集成開發環境作為複雜數字系統設計的平台，以基礎的數字邏輯和數字電路知識為起點，以Xilinx 7系列可編程邏輯器件和Verilog HDL為載體，詳細介紹了數字系統中基本邏輯單元RTL描述方法。在此基礎上，實現了複雜數字系統設計、數模混合系統設計和基於Cortex-M1處理器軟核的片上嵌入式系統設計。全書共10章，內容主要包括數字邏輯基礎、數字邏輯電路、可編程邏輯器件原理、Vivado集成開發環境設計流程、Verilog HDL語言規範、基本數字邏輯單元Verilog HDL描述、複雜數字系統設計和實現、數模混合系統設計、片上嵌入式系統的構建和實現
，以及圖像採集、處理系統的構建和實現。本書適合於需要系統掌握Verilog HDL和Vivado集成開發環境基本設計流程的初學者，同時也適用於需要掌握ARM嵌入式系統軟體和硬體設計方法的嵌入式開發工程師。 何賓 知名的嵌入式和EDA技術專家，長期從事電子設計自動化方面的教學和科研工作，與全球多家知名的半導體廠商和EDA工具廠商密切合作。已經出版電子資訊方面的著作共50餘部，內容涵蓋電路模擬、電路設計、FPGA、數位信號處理、單片機、嵌入式系統、物聯網等。 典型的代表作有《類比電子系統設計指南（基礎篇）：從半導體、分立元件到TI積體電路的分析與實現》、《類比電子系
統設計指南（實踐篇）：從半導體、分立元件到TI積體電路的分析與實現》、《Xilinx Zynq-7000嵌入式系統設計與實現：基於ARM Cortex-A9雙核處理器和Vivado的設計方法》、《Altium Designer 17一體化設計標準教程-從模擬原理和PCB設計到單片機系統》、《STC8系列單片機開發指南：面向處理器、程式設計和作業系統的分析與應用》、《Xilinx FPGA數位信號處理系統設計指南：從HDL、Simulink到HLS的實現》、《可重構嵌入式系統設計與實現：基於Cypress PSoC4 BLE智慧互聯平臺》等。 第1章 數位邏輯基礎 1.1 數
位邏輯的發展史 1.2 SPICE模擬工具基礎 1.2.1 SPICE的分析功能 1.2.2 SPICE的分析流程 1.3開關系統 1.3.1 0和1的概念 1.3.2 開關系統的優勢 1.3.3 電晶體作為開關 1.3.4 半導體物理器件 1.3.5 半導體邏輯電路 1.3.6 邏輯電路符號 1.4 半導體數位積體電路 1.4.1 積體電路發展 1.4.2 積體電路構成 1.4.3 積體電路版圖 1.5 基本邏輯門及特性 1.5.1 基本邏輯門 1.5.2 基本邏輯門積體電路 1.5.3 邏輯門電路的傳輸特性 1.5.4 不同邏輯門的連接 1.6 邏輯代數理論 1.6.1 邏輯代數中運算關係
1.6.2 邏輯函數運算式 1.7 邏輯運算式的化簡 1.7.1 使用運算律化簡邏輯運算式 1.7.2 使用坎諾圖化簡邏輯運算式 1.7.3 不完全指定邏輯功能的化簡 1.7.4 輸入變數的坎諾圖表示 1.8 毛刺產生及消除 1.9 數位碼制表示和轉換 1.9.1 數字碼制表示 1.9.2 數位碼制轉換 第2章 數位邏輯電路 2.1 組合邏輯電路 2.1.1 編碼器 2.1.2 解碼器 2.1.3 碼轉換器 2.1.4 多路選擇器 2.1.5 數字比較器 2.1.6 加法器 2.1.7 減法器 2.1.8 加法器/減法器 2.1.9 乘法器 2.2 時序邏輯電路 2.2.1 時序邏輯電路類
型 2.2.2 時序邏輯電路特點 2.2.3 基本SR鎖存器 2.2.4 同步SR鎖存器 2.2.5 D鎖存器 2.2.6 D觸發器 2.2.7 其他觸發器 2.2.8 普通寄存器 2.2.9 移位暫存器 2.3 記憶體 2.3.1記憶體的分類 2.3.2記憶體工作原理 2.3.3易失性記憶體 2.3.4非易失性記憶體 2.4有限狀態機 2.4.1有限狀態機的原理 2.4.2狀態圖表示及實現 2.4.3三位元數目器的設計與實現 第3章 可程式設計邏輯器件原理 3.1可程式設計邏輯器件發展歷史 3.2可程式設計邏輯器件工藝 3.3可程式設計邏輯器件結構 3.3.1PROM結構 3.3.2PAL
結構 3.3.3PLA結構 3.4複雜可程式設計邏輯器件結構 3.4.1功能塊 3.4.2巨集單元 3.4.3快速連接開關陣列 3.4.4輸入/輸出塊 3.5現場可程式設計閘陣列結構 3.5.1查閱資料表結構原理 3.5.2可配置的邏輯塊 3.5.3時鐘管理資源 3.5.4塊記憶體資源 3.5.5互聯資源 3.5.6DSP切片 3.5.7輸入/輸出塊 3.5.8XADC模組 3.6Xilinx 7系列FPGA產品 第4章 Vivado整合式開發環境設計流程 4.1Vivado整合式開發環境 4.2創建新的設計工程 4.3創建並添加一個新的設計檔 4.4詳細描述 4.4.1詳細描述的原理 4.
4.2詳細描述的實現過程 4.5設計行為級模擬 4.6設計綜合和分析 4.6.1綜合過程的關鍵問題 4.6.2執行設計綜合 4.6.3查看綜合報告 4.7約束檔對話方塊 4.7.1約束檔 4.7.2I/O規劃器的功能 4.7.3實現約束 4.8設計實現和分析 4.8.1設計實現原理 4.8.2設計實現及分析 4.9設計時序模擬 4.10生成並下載位元流檔 4.10.1FPGA配置原理 4.10.2生成位元流檔 4.10.3下載位元流文件 4.11生成並燒寫PROM檔 第5章 Verilog HDL規範 5.1Verilog HDL發展 5.2Verilog HDL程式結構 5.2.1模組聲明
5.2.2模組埠定義 5.2.3邏輯功能定義 5.3Verilog HDL描述方式 5.3.1行為級描述 5.3.2資料流程描述 5.3.3結構級描述 5.3.4開關級描述 5.4Verilog HDL要素 5.4.1注釋 5.4.2間隔符 5.4.3識別字 5.4.4關鍵字 5.4.5系統任務和函數 5.4.6編譯器指令 5.4.7運算子 5.4.8數字 5.4.9字串 5.4.10屬性 5.5Verilog HDL資料類型 5.5.1值的集合 5.5.2網路和變數 5.5.3向量 5.5.4強度 5.5.5隱含聲明 5.5.6網路類型 5.5.7寄存器類型 5.5.8整型、實數型、時間型
和即時時間 5.5.9陣列 5.5.10參數 5.5.11Verilog HDL名字空間 5.6Verilog HDL運算式 5.6.1操作符 5.6.2運算元 5.6.3延遲運算式 5.6.4運算式的位寬 5.6.5有符號運算式 5.6.6分配和截斷 5.7Verilog HDL分配 5.7.1連續分配 5.7.2過程分配 5.8Verilog HDL門級和開關級描述 5.8.1門和開關聲明 5.8.2邏輯門 5.8.3輸出門 5.8.4三態門 5.8.5MOS開關 5.8.6雙向傳輸開關 5.8.7CMOS開關 5.8.8pull門 5.9Verilog HDL用戶自訂原語 5.9.1UD
P定義 5.9.2組合電路UDP 5.9.3電平觸發的時序UDP 5.9.4邊沿觸發的時序UDP 5.9.5邊沿和電平觸發的混合行為 5.10Verilog HDL行為描述語句 5.10.1過程語句 5.10.2過程連續分配 5.10.3條件陳述式 5.10.4case語句 5.10.5迴圈語句 5.10.6過程時序控制 5.10.7語句塊 5.10.8結構化的過程 5.11Verilog HDL任務和函數 5.11.1任務和函數的區別 5.11.2定義和使能任務 5.11.3禁止命名的塊和任務 5.11.4聲明和調用函數 5.12Verilog HDL層次化結構 5.12.1模組和模組例化
5.12.2覆蓋模組參數值 5.12.3埠 5.12.4生成結構 5.12.5層次化的名字 5.12.6向上名字引用 5.12.7範圍規則 5.13Verilog HDL設計配置 5.13.1配置格式 5.13.2庫 5.13.3配置例子 5.14Verilog HDL指定塊 5.14.1模組路徑聲明 5.14.2為路徑分配延遲 5.14.3混合模組路徑延遲和分散式延遲 5.14.4驅動佈線邏輯 5.14.5脈衝過濾行為的控制 5.15Verilog HDL時序檢查 5.15.1使用一個穩定視窗檢查時序 5.15.2時鐘和控制信號的時序檢查 5.15.3邊沿控制識別字 5.15.4提示符：用戶
定義對時序衝突的回應 5.15.5使能帶有條件的時序檢查 5.15.6時序檢查中的向量信號 5.15.7負時序檢查 5.16Verilog HDL SDF逆向注解 5.16.1SDF注解器 5.16.2映射SDF結構到Verilog 5.16.3多個注解 5.16.4多個SDF檔 5.16.5脈衝限制注解 5.16.6SDF到Verilog延遲值映射 5.17Verilog HDL系統任務和函數 5.17.1顯示任務 5.17.2檔I/O任務和函數 5.17.3時間標度任務 5.17.4模擬控制任務 5.17.5隨機分析任務 5.17.6模擬時間函數 5.17.7轉換函數 5.17.8概率分佈
函數 5.17.9命令列輸入 5.17.10數學函數 5.18Verilog HDL的VCD文件 5.18.1Vivado創建四態VCD文件 5.18.2Verilog源創建四態VCD文件 5.18.3四態VCD檔案格式 5.19Verilog HDL編譯器指令 5.19.1`celldefine和`endcelldefine 5.19.2`default_nettype 5.19.3`define和`undef 5.19.4`ifdef、 `else、 `elsif、 `endif、 `ifndef 5.19.5`include 5.19.6`resetall 5.19.7`line 5.1
9.8`timescale 5.19.9`unconnected_drive和`nounconnected_drive 5.19.10`pragma 5.19.11`begin_keywords和`end_keyword 5.20Verilog HDL（IEEE 1364—2005）關鍵字列表 第6章 基本數位邏輯單元Verilog HDL描述 6.1組合邏輯電路Verilog HDL描述 6.1.1邏輯門Verilog HDL描述 6.1.2編碼器Verilog HDL描述 6.1.3解碼器Verilog HDL描述 6.1.4多路選擇器Verilog HDL描述 6.1.5數字比較器Ve
rilog HDL描述 6.1.6匯流排緩衝器Verilog HDL描述 6.2資料運算操作Verilog HDL描述 6.2.1加法操作Verilog HDL描述 6.2.2減法操作Verilog HDL描述 6.2.3乘法操作Verilog HDL描述 6.2.4除法操作Verilog HDL描述 6.2.5算數邏輯單位Verilog HDL描述 6.3時序邏輯電路Verilog HDL描述 6.3.1觸發器和鎖存器Verilog HDL描述 6.3.2計數器Verilog HDL描述 6.3.3移位暫存器Verilog HDL描述 6.3.4脈衝寬度調製Verilog HDL描述 6.4
記憶體Verilog HDL描述 6.4.1ROM的Verilog HDL描述 6.4.2RAM的Verilog HDL描述 6.5有限自動狀態機Verilog HDL描述 6.5.1FSM設計原理 6.5.2FSM的應用——序列檢測器的實現 6.5.3FSM的應用——交通燈的實現 6.6演算法狀態機Verilog HDL描述 6.6.1演算法狀態機原理 6.6.2ASM到Verilog HDL的轉換 第7章 複雜數位系統設計和實現 7.1設計所用外設的原理 7.1.1LED驅動原理 7.1.2開關驅動原理 7.1.37段數碼管驅動原理 7.1.4VGA顯示器原理 7.1.5通用非同步接收發
送器原理 7.2系統中各個模組的功能 7.3創建新的設計工程 7.4Verilog HDL數位系統設計流程 7.4.1創建divclk1.v文件 7.4.2創建divclk2.v文件 7.4.3創建divclk3.v文件 7.4.4創建divclk4.v文件 7.4.5創建pwm_led.v文件 7.4.6創建counter4b.v文件 7.4.7創建seg7display.v文件 7.4.8創建uart.v文件 7.4.9創建顯示處理檔 7.4.10創建top.v文件 7.5添加XDC約束 7.6設計下載和驗證 第8章 數模混合系統設計 8.1信號採集和處理的實現 8.1.1XADC模組原
理 8.1.2XADC原語 8.1.31602字元LCD模組原理 8.1.4信號採集、處理和顯示的實現 8.2信號發生器的實現 8.2.1DAC工作原理 8.2.2函數信號產生原理 8.2.3設計實現 第9章 片上嵌入式系統的構建和實現 9.1ARM AMBA規範 9.2Cortex-M1內部結構和功能 9.2.1處理器內核及寄存器組 9.2.2Cortex-M1存儲空間及映射 9.2.3系統控制寄存器 9.2.4內核記憶體介面 9.2.5嵌套向量中斷控制器 9.2.6匯流排主設備 9.2.7AHB-PPB 9.2.8調試 9.3Cortex-M1系統時鐘和重定 9.4Cortex-M1嵌入
式系統硬體設計 9.4.1建立新的嵌入式設計工程 9.4.2定制7段數碼管IP核 9.4.3定制按鍵消抖IP核 9.4.4設置IP核路徑 9.4.5連接IP構建嵌入式系統硬體 9.4.6對塊設計進行預處理 9.5Cortex-M1指令系統 9.5.1Thumb指令集 9.5.2組合語言格式 9.5.3寄存器訪問指令——MOVE 9.5.4寄存器訪問指令——LOAD 9.5.5記憶體訪問指令——STORE 9.5.6多個資料訪問指令 9.5.7堆疊訪問指令 9.5.8算數運算指令 9.5.9邏輯操
低功耗非晶態氧化銦鎢鋅之銅導電橋式記憶體與薄膜電晶體整合研究
為了解決隨機 記憶體 驅動 電路 的問題，作者李侑軒 這樣論述：
隨著高解析度顯示器的發展，有愈來愈多數量的像素會被嵌入至顯示器的面板之中，這會衍生出顯示器中電能消耗的問題，因此就有所謂內嵌式記憶像素(Memory in Pixel, MIP)的概念被提出用於降低目前顯示器中的電功率消耗，但也因為目前主流MIP中的類靜態隨機存取式記憶體功能(SRAM-like Function)是屬於揮發型的記憶體，同時此架構也會使製程更加複雜。因此，必須發展一種節能且高元件整合密度的顯示面板技術，利用將記憶體單元串聯在薄膜電晶體(Thin Film Transistors, TFT)上的1T1R結構，使非揮發性記憶體元件內嵌於顯示面板畫素電路中，達到具有記憶特性的畫素單
元之節能技術。近幾年，新穎的非揮發型記憶體元件紛紛被提出，其中電橋式隨機存取記憶體(Conductive Bridge Random Access Memory, CBRAM)是目前被視為最具開發潛力的非揮發型記憶體，其具有結構簡單和低功率消耗等特色。我們整合CBRAM及TFT元件實現同時有驅動和記憶功能的1T1R元件，其中元件裡最關鍵的主動層，均採用了新興的透明非晶態氧化物半導體—氧化銦鎢鋅(InWZnO, IWZO)作為CBRAM的阻態切換層和TFT的通道層。為了優化CBRAM電性表現，我們額外插入一層極薄的介電質至元件中，並調變IWZO薄膜的厚度得出最佳化記憶體特性之雙層(Bilayer
)結構的CBRAM元件；在TFT方面藉由調變通道層的製程參數，將得到最佳化之電晶體特性和驅動能力的IWZO TFT元件。因此我們將兩者最佳元件整合成1T1R結構。在記憶體的電性表現上，單一CBRAM元件在耐久度測試中，能於低電流條件下成功操作多次，但1T1R元件在耐久度測試上的表現略差，原因是1T1R元件經過多次阻態切換後，進而導致TFT的驅動能力劣化。除了可靠性的測試外，單一CBRAM與1T1R元件皆在阻態切換的操作上展現了μW等級之相當低的電功率消耗，此為節能顯示器的記憶功能應用奠定了一定的基礎。